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[判断题]

7485为4位二进制比较器。如果二进制数A=B,则其输出必将是Y(A=B)有效。()

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第1题
试编子程序,返回16位二进制数中指定位段的零状态。已知: 入口参数:AX=16位二进制数; BL=高4位b1、低4位b0;

试编子程序,返回16位二进制数中指定位段的零状态。已知:

入口参数:AX=16位二进制数;

BL=高4位b1、低4位b0;

其中b1和b0分别为位段最高位编号和最低位的编号(15~0)。

出口参数:CE=0;

若指定位段为0,ZF=1,否则ZF=0。

注意:若b1小于b0,则不予处理,返回CF=1。

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第2题
IBM PC机的存储器单元的物理地址是用()表示的。A 5位十进制数B 20位无符号二进制数C 4位十六进

IBM PC机的存储器单元的物理地址是用()表示的。

A 5位十进制数

B 20位无符号二进制数

C 4位十六进制数

D 20位带符号二进制数

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第3题
下列说法正确的是()。

A.二进制数只由两位数组成

B.二进制转化为八进制时,当分组不足3位,分别向高位或低位补0凑成3位

C.十进制转化为其它进制时,其整数部分和小数部分在转换时需作不同的计算

D.八进制转化为十六进制时,可以通过二进制数作为中间桥梁,先转化为二进制数,再转化为十六进制

E.二进制转化为十六进制时,当分组不足4位,分别向高位或低位补0凑成4位

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第4题
图6-18所示电路可用作阶梯波发生器。如果计数器是加/减计数器,它和DAC相适应,均是十位(二进制数),

图6-18所示电路可用作阶梯波发生器。如果计数器是加/减计数器,它和DAC相适应,均是十位(二进制数),时钟频率为1 MHz,求阶梯波的重复周期,试画出加法计数和减法计数时DAC的输出波形(控制信号S=0,加计数;S=1,减计数)。

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第5题
片内RAM40H开始的单元内有10字节的二进制数,下面程序是完成找出其中最大值并存于50H单元中。START

片内RAM40H开始的单元内有10字节的二进制数,下面程序是完成找出其中最大值并存于50H单元中。

START:MOV R0,#40H ;数据块首地址送R0

MOV R7,#09H ;比较次数送R7

MOV A,R0 ;取数送A

LOOP: INC R0

MOV 30H,@R0 ;取数送30H

CJNE A,30H,NEHT ;(A)与(30H)相比

NEXT:JNC BIE1 ;(A)≥(30H)转BIR1

MOV A,30H ;(A)<(30H),大数送A

BIE1: DJNZ R7,LOOP ;比较次数减1,不为0,继续比较

MOV 50H,A ;比较结束,大数送50H

RET

错误:______

改正:______

参考答案:错误

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第6题
十进制数-123的8位二进制数补码为().

A.01111011

B.10000100

C.10000101

D.11111011

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第7题
十进制数 23.75转换成二进制数为(),二进制数11.011转换成十进制数为()。

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第8题
二进制数01111转换为十进制数为15。()
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第9题
将二进制数11011101011.010111011化为十六进制为()。

A.3353.273

B.672A.273

C.DD6.0BB

D.6EB.5D8

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第10题
用4位二进制加法计数器74161构成的计数器电路如图所示,则对该计数器应用电路功能描述正确的是()。

A.余3码编码的十进制加法计数器

B.循环码编码的九进制加法计数器

C.余3码编码的三进制加法计数器

D.循环码编码的二进制加法计数器

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第11题
假设两个一字节的十六进制数9FH,81H相加的和为8位二进制数,那么相加后其进位标志为______,溢出标
志为______。

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