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[主观题]

在图P5-5所示的触发器电路中,A和B的波形已知,对应画出Q0、Q1、Q2和Q3的波形,设各触发器的初始状

态为0。

在图P5-5所示的触发器电路中,A和B的波形已知,对应画出Q0、Q1、Q2和Q3的波形,设各触发器的

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第1题
位二进制加法计数器CT74161和集成单稳态触发器CT74LS121组成如图P6.10(a)所示的电路.(1)分析CT
位二进制加法计数器CT74161和集成单稳态触发器CT74LS121组成如图P6.10(a)所示的电路.(1)分析CT

位二进制加法计数器CT74161和集成单稳态触发器CT74LS121组成如图P6.10(a)所示的电路.

(1)分析CT74161组成电路,画出转换状态图.

(2)估算CT74LS121组成电路的输出脉宽Tw值.

(3)设CP为方波(周期Td≥1ms),在图P6.10(b)中画出图P6.10(a)中u1、u0两点的工作波形.

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第2题
试用图4.3.14(a)给定的触发器和逻辑门设计波形产生电路。要求图(a)中的各信号满足图4.3.14(b)所示

试用图4.3.14(a)给定的触发器和逻辑门设计波形产生电路。要求图(a)中的各信号满足图4.3.14(b)所示时序关系。

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第3题
试分析图所示电路,说明电路功能和每级触发器Q端输出的权值。

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第4题
图10.5(a)所示为单稳态触发器组成的定时电路,uA,uB信号如图10.5(b)所示,单稳态触发器
图10.5(a)所示为单稳态触发器组成的定时电路,uA,uB信号如图10.5(b)所示,单稳态触发器

为上升沿触发式,哲稳态持续时间为400us,uB为频率10kHz的脉冲信号,根据给定条件分别画出uC及输出uO的波形.

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第5题
分析图题6.2.5所示同步时序电路,写出各触发器的激励方程、电路的状态方程组和输出方程,画出状态
表和状态图。

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第6题
试用边沿JK触发器设计一个时序逻辑电路,要求该电路的输出Z与CP之间的关系应满足图10.21所示的
波形图.

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第7题
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如
画出图P5.6(a)中脉冲触发SR触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入S、R的电压波形如

图P5.6(b)所示。设触发器的初始状态为Q=0。

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第8题
在图3—21所示逻辑电路中,若门A、B及C的传输延迟范围如图中所注,试决定该电路的总传输延迟范围是多
少。

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第9题
在图LP4-50所示的电流源电路中,已知ΥCC=30Υ,R=30kΩ,T=300K, 试确定R2,并求输出交流电

在图LP4-50所示的电流源电路中,已知ΥCC=30Υ,R=30kΩ,T=300K, 试确定R2,并

求输出交流电阻R0.(补充条件:β=100,|VA|=100VC)

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第10题
在图4-59所示的电路中,已知。

在图4-59所示的电路中,已知

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第11题
写出图P5.18(a)电路中表示触发器的次态Q'与它的现态Q和输入A、B之间关系的逻辑函数式,并画出
写出图P5.18(a)电路中表示触发器的次态Q'与它的现态Q和输入A、B之间关系的逻辑函数式,并画出

当CLK和A、B为图P5.18(b)给定电压波形时,Q端对应的电压波形。设触发器的初始状态为Q=0。

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