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[判断题]

同步电路：存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源，因而所有触发器的状态的变化都与所加的时钟脉冲信号同步（）

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第1题

同步计数器和异步计数器比较，同步计数器的最显著优点是（)

A.工作速度高

B.触发器利用率高

C.电路简单

D.不受时钟CP控制

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第2题

同步计数器和异步计数器比较,同步计数器的显著优点是().

同步计数器和异步计数器比较,同步计数器的显著优点是（).

A.工作速度高

B.触发器利用率高

C.电路简单

D.不受时钟CLK控制

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第3题

在同步RS触发器中，R.S.CP分别称是（)。

A.电源端

B.地端

C.时钟输入端

D.置位端

E.复位端

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第4题

同步时序电路设计中，状态编码采用相邻编码法的目的是（)。

A.减少电路中的逻辑门

B.提高电路速度

C.提高电路可靠性

D.减少电路中的触发器

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第5题

目前较大功率晶闸管的触发电路有以下（)形式。

A.程控单结晶闸管触发器

B.同步信号为正弦波触发器

C.同步信号为锯齿波触发器

D.同步信号为方波触发器

E.KC系列集成触发器

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第6题

同步计数器和异步计数器相比较，前者的显著优点是（)。

A.工作速度快

B.触发器利用率高

C.电路简单

D.不受时钟脉冲控制

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第7题

写出图P5.18(a)电路中表示触发器的次态Q'与它的现态Q和输入A、B之间关系的逻辑函数式，并画出

写出图P5.18（a)电路中表示触发器的次态Q'与它的现态Q和输入A、B之间关系的逻辑函数式，并画出

当CLK和A、B为图P5.18(b)给定电压波形时，Q端对应的电压波形。设触发器的初始状态为Q=0。

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第8题

分析图题6.2.5所示同步时序电路，写出各触发器的激励方程、电路的状态方程组和输出方程，画出状态

表和状态图。

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第9题

如果计数器的计数脉冲不是同时加到所有触发器的计数输入端，而只加到最低位触发器的计数输入端，其他各级触发器则由相邻的低位触发器来触发，这时计数器称为（)。

A.同步计数器

B.异步计数器

C.可逆数器

D.步计数器

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第10题

电路如图4．4．6所示，经

脉冲作用后，如要使得触发器的状态不变，则A、B输入应为()。

A.A=0．B=0

B.A=1，B=1

C.A=O，B=1

D.A=1，B=0

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第11题

集成电路中具有记忆功能的是（)。

A.与非门电路

B.RS触发器

C.或非门电路

D.多谐振器

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